Intel のサポート対象プラットフォーム
Intel（B200 M5、B480 M5、C220 M5、C240 M5、C480 M5、S3260 M5、B200 M6、C220 M6、C240 M6、X210c M6、C220 M7、C240 M7、X210c M7、X410c M7、C220 M8、C240 M8、X210c M8）プラットフォームに該当する BIOS トークン
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名前 |
説明 |
Versions |
値（Value） |
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[試行数（Number of Retries）] |
ブートの試行数。
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4.1(1) 以降 |
無制限13, 5
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[クール ダウン時間（Cool Down Time（秒）] |
次のブートを試行するまで待機する時間（秒単位）。次のいずれかになります。
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4.1(1) 以降 |
15 秒、45 秒、90 秒
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Boot Option Retry |
BIOS でユーザ入力を待機せずに非 EFI ベースのブート オプションを再試行するかどうかを設定します。
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4.1(1) 以降 |
無効、有効
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| IPV4 HTTPのサポート |
HTTP の IPv4 サポートを有効または無効にします。 |
4.2(1) 以降 |
無効、有効
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IPV6 HTTPのサポート |
HTTP の IPv6 サポートを有効または無効にします。 |
4.2(1) 以降 |
無効、有効
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| IPv4 PXEのサポート |
PXE の IPv4 サポートを有効または無効にします。 |
4.2(1) 以降 |
無効、有効
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| [IPV6 PXE サポート（IPV6 PXE Support）] |
PXE の IPv6 サポートを有効または無効にします。 |
4.2(1) 以降 |
無効、有効
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| ネットワークスタック |
このオプションを使用すると、システムの完全なネットワーク スタイルを有効または無効にすることができます。 |
4.1(1) 以降 |
無効、有効
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[電源オンパスワード（Power ON Password）] |
このトークンでは、F2 BIOS 設定を使用する前に BIOS パスワードを設定する必要があります。有効にすると、BIOS 関数（IO 設定、BIOS セットアップ、BIOS を使用したオペレーティング システムへのブート）にアクセスする前にパスワードの検証が必要になります。
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4.1(1) 以降 |
無効、有効
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P-SATA OptionROM |
このオプションでは、P-SATA モードを選択できます。 |
4.1(1) 以降 |
無効、LSI SW RAID、AHCI
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SATA Mode |
このオプションでは、SATA モードを選択できます。 |
4.1(1) 以降 |
AHCI、LSISW RAID、無効
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[VMD 有効化（VMD Enablement）] |
PCIe バスに接続されている NVMe SSD をスワップできるかどうかを指定します。この設定により、これらのドライブの LED ステータス ライトも標準化されます。LED ステータス ライトは、特定の障害インジケータ パターンを表示するようにオプションでプログラムできます。
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4.1(1) 以降 |
無効、有効
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[Intel VT for directed IO] |
Intel Virtualization Technology for Directed I/O（VT-d）をプロセッサで使用するかどうか設定します。 |
4.1(1) 以降 |
有効、無効
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[Intel(R) VT-d Coherency サポート（Intel(R) VT-d Coherency Support）] |
プロセッサで Intel VT-d Coherency をサポートするかどうか設定します。 |
4.1(1) 以降 |
有効、無効
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| Intel VTD ATSサポート |
プロセッサで Intel VT-d Address Translation Services（ATS）をサポートするかどうか設定します。 |
4.1(1) 以降 |
無効、有効
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プリブートDMA保護 |
起動プロセス中に不正なダイレクト メモリ アクセス（DMA）を防止することを目的とした BIOS 設定であり、悪意のあるデバイスがシステム メモリにアクセスするのを防ぐ可能性があります。 |
4.3 (6a) |
無効、有効
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[ACS 制御 GPU n（ACS Control GPU n）]（n は 1 ～ 14 の範囲） |
アクセス コントロール サービス（ACS）を使用すると、プロセッサは、GPU の複数のデバイス間のピアツーピア通信を有効または無効にすることができます。
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4.0(4) 以降 |
有効、無効
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[LOM の CDN サポート（CDN Support for LOM）] |
イーサネット ネットワーキング識別子の命名規則を、Consistent Device Naming（CDN）と従来の命名規則のどちらに準拠させるかを指定します。 |
4.0(4) 以降 |
有効、無効
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外部SSCの有効化 |
このオプションでは、外部クロック ジェネレータのクロック拡散スペクトルを有効または無効にすることができます。 |
4.1(2) 以降 |
有効、無効、0P3_Percent、0P5_Percent、ハードウェア、オフ
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| [IIO eDPC サポート（IIO eDPC Support）] |
このオプションを使用すると、修正不可能なエラーの後にダウンストリーム リンクを無効にすることができるため、制御された堅牢な方法で回復することが可能になります。 |
4.2(1) 以降 |
無効、致命的なエラーで、致命的なエラーおよび致命的でないエラーで |
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| [LOM ポート n OptionROM（LOM Port n OptionROM）]。n の範囲は 0 ～ 3 です。 |
オプション ROM が LOM ポート n で使用できるかどうか
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4.0(4) 以降 |
無効、有効、Legacy のみ、UEFI のみ
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| PCIe PLL SSC パーセント |
すべての PCIe PLL SSC ポートが有効であるか、無効であるか。 |
4.1(2) 以降 |
0 ～255 （単位は（n/10）%） |
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| [MRAID n リンク速度（MRAID n Link Speed）]。n の範囲は 1 ～ 2 です。 |
このオプションでは、MRAID の最高速度を制限することができます。
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4.0(2) 以降 |
自動、無効、GEN 1、GEN 2、GEN 3、GEN 4、GEN 5
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| [MRAID n OptionROM]。n の範囲は 1 ～ 2 です。 |
MRAID ポートでオプション ROM を使用可能にするかどうか設定。
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4.0(2) 以降 |
無効、有効
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| PCIeスロットMSTOR RAID OptionROM |
サーバが PCIe MSTOR RAID のオプション ROM を使用するかどうか。
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4.2(1) 以降 |
無効、有効
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| [NVME n リンク速度（NVME n Link Speed）]。n の範囲は 0 ～ 6 と 13 ～ 24 です。 |
このオプションでは、PCIe スロットに取り付けられた NVME カードの最高速度を制限することができます。
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4.0(2) 以降 |
無効、自動、GEN1、GEN2、GEN3、GEN4、GEN5
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| [NVME n OptionROM]。n の範囲は 0 ～ 6 です。 |
このオプションでは、SSD:NVMe スロットnに接続された PCIe アダプタのオプション ROM の実行を制御することができます。 |
4.0(2) 以降 |
Enabled、Disabled
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| [PCIe スロット n リンク速度（PCIe Slot n Link Speed）]。n の範囲は 1 ～ 8 です。 |
スロット n で指定された PCIe スロットのリンク速度。 |
4.0（1）以降 |
無効、自動、GEN1、GEN2、GEN3、GEN4、GEN5 GEN5 は、速度 1 ～ 6 でのみサポートされます。
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| PCIe スロット： LOMリンク速度 |
PCIe スロット： LOM のリンク速度の構成。 |
4.0（1）以降 |
無効、自動、GEN1、GEN2、GEN3
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| n の範囲が 1 ～ 8 の PCIe Slot nOptionROM |
オプション ROM がポートで使用できるかどうか。 |
4.0(2) 以降 |
無効、有効、Legacy のみ、UEFI のみ
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| [前面 NVME n リンク速度（Front NVME n Link Speed）]。n の範囲は 1 ～ 12 です。
C245 M8 プラットフォームの場合、 n の範囲は 1 ～ 4 です。 |
このオプションでは、フロント PCIe スロットに取り付けられた NVME カードの最高速度を制限することができます。 |
4.0(4) 以降 |
無効、自動、GEN1、GEN2、GEN3、GEN4、GEN5
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| [前面 NVME n OptionROM（Front NVME n OptionROM）]。n の範囲は 1 ～ 24 です。
C245 M8 プラットフォームの場合、 n の範囲は 1 ～ 4 です。 |
このオプションでは、SSD:NVMe スロットnに接続された PCIe アダプタのオプション ROM の実行を制御することができます。 |
4.2(1) 以降 |
有効、無効
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| [PCIe LOM:1 および 2 リンク（PCIe LOM:1 and 2 Link）] |
このオプションを使用すると、PCIe スロット 1 および 2 に装着されているアダプタカードの最大速度を制限できます。 |
4.0（1）以降 |
Enabled、Disabled
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| スロットメザニンの状態 |
このオプションを使用すると、PCIe スロットの Mezz 状態を構成できます。 |
4.0（1）以降 |
無効、有効、Legacy のみ、UEFI のみ
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| PCIe スロット: MLOM リンク速度（PCIe Slot:FLOM Link Speed） |
このオプションを使用すると MLOM アダプタの最大速度を制限できます。 |
4.0(1) 以降 |
自動、無効、GEN 1、GEN 2、GEN 3、GEN 4、GEN 5
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| PCIe Slot:MLOM OptionROM |
オプション ROM が MLOM ポートで使用できるかどうか。 |
4.0（1）以降 |
無効、有効、Legacy のみ、UEFI のみ
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| [MRAID リンク速度（MRAID Link Speed）] |
このオプションでは、MRAID の最高速度を制限することができます。 |
4.0(2) 以降 |
自動、無効、GEN 1、GEN 2、GEN 3、GEN 4、GEN 5
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| [PCIe Slot:MRAID OptionROM] |
オプション ROM が MLOM ポートで使用できるかどうか。 |
4.0(2) 以降 |
無効、有効、Legacy のみ、UEFI のみ
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| n の範囲が 1 ～ 8 の PCIe Slot nOptionROM |
オプション ROM がポートで使用できるかどうか。 |
4.0(2) 以降 |
無効、有効、Legacy のみ、UEFI のみ
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| RAID Link Speed |
このオプションを使用すると RAID の最大速度を制限できます。 |
4.0（1）以降 |
無効、自動、GEN1、GEN2、GEN3
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| [PCIe スロット RAID オプション ROM（PCIe Slot MLOM OptionROM）] |
オプション ROM が RAID スロットで使用できるかどうか。 |
4.0（1）以降 |
有効、無効
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| [背面 NVME n リンク速度（Rear NVME n Link Speed）]。n の範囲は 1 ～ 4 です。 |
このオプションを使用すると背面 NVME の最大速度を制限できます。
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4.0(4) 以降 |
自動、無効、GEN 1、GEN 2、GEN 3、GEN 4、GEN 5
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| [背面 NVME n OptionROM（Rear NVME n OptionROM）]。n の範囲は 1 ～ 4 です。 |
オプション ROM が背面 NVME で使用できるかどうか。 |
4.0(4) 以降 |
有効、無効
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| [PCIe Slot:Riser リンク速度 n（PCIe Slot:Riser Link Speed n）]。n は 1 および 2 です。 |
このオプションを使用するとライザーの最大速度を制限できます。 |
4.0(4) 以降 |
無効、自動、GEN1、GEN2、GEN3
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| [PCIe Slot:Riser n スロット x リンク速度（PCIe Slot:Riser n Slot x Link Speed）]。n は 1 と 2、x は 1 ～ 6 です。 |
このオプションを使用するとx スロットのライザーの最大速度を制限できます。 |
4.0(2) 以降 |
無効、自動、GEN1、GEN2、GEN3
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| PCIe スロット：SAS オプション ROM（PCIe Slot:SAS OptionROM） |
オプション ROM が SAS スロットで使用できるかどうか。 |
4.0(2) 以降 |
無効、有効、Legacy のみ、UEFI のみ
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| [PCIe Slot:FrontSSD n リンク速度（PCIe Slot:FrontSSD nLink Speed）]。n は 1 および 2 です。 |
このオプションを使用すると前面 SSD の最大速度を制限できます。 |
4.0(2) 以降 |
無効、自動、GEN1、GEN2、GEN3
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BAR のサイズ変更サポート |
サイズ変更可能な BAR サポートのセットアップ項目を有効または無効にできます。 |
4.3(4b) 以降 |
有効、無効
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CDN は一貫したデバイスの命名を指すPCIe スロット CDN 制御 |
PCIe スロットの Consistent Device Naming（CDN）制御により、PCIe スロットに一貫した方法で名前を付けることができます。これにより PCIe スロットの名前は、より統一され、識別しやすくなり、構成に変更が加えられても永続的に保持されます。
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4.0(2) 以降 |
有効、無効
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| Consistent Device Naming（CDN）制御 |
PCIe スロットの Consistent Device Naming（CDN）制御により、PCIe スロットに一貫した方法で名前を付けることができます。これにより PCIe スロットの名前は、より統一され、識別しやすくなり、構成に変更が加えられても永続的に保持されます。
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4.0(2) 以降 |
有効、無効
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| ACPI SRATの特殊な目的のメモリフラグ |
[UEFI メモリ マップの特殊な目的フラグ（UEFI Memory Map Special Purpose Flag）] が有効になっている場合、[ACPI SRAT SPメモリフラグ（ACPI SRAT SP Memory flag）] を有効または無効にします。
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4.3(5b) 以降 |
無効、有効
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UEFIメモリマップの特殊な目的のメモリフラグ |
[UEFIメモリマップの特殊ノブ（UEFI Memory Map Special knob）] 設定を有効または無効にすると、特定のオペレーティングシステムの [CXL] カードに影響します。
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4.3(5b) 以降 |
無効、有効
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| 強力なメモリテスト | システムの起動中に拡張メモリ テストを有効にします。メモリ量に応じて起動時間は長くなります。
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4.0（1）以降 |
無効、有効、自動
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| [BME DMA 緩和（BME DMA Mitigation）] |
不正な外部 DMA からの脅威を緩和するため、PCI BME ビットを無効にできます。
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4.0（1）、4.0（2）、4.0（4）、4.1（1）、4.2（1）、4.3（4b）4.3(5a) |
有効、無効
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MMIO 高粒度サイズ |
メモリマップド I/O （MMIO）リソースの割り当てに使用する割り当てサイズを選択します。 |
4.3(3c) 以降 |
1G、 4G、16G、64G、 256G、1024G、自動
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MMIO ハイベース |
I/O （MMIO リソース）のメモリアドレス マッピングに基づく基本メモリ サイズ |
4.3(3c) 以降 |
512G、1T、2T、4T、16T、24T、32T、40T、56T、自動
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| CR QoS |
同時 DCPMM BW 飽和スレッドの存在下での DRAM およびシステム全体の BW ドロップを防止し、同種の DDRT のみの使用への影響を最小限に抑えます。マルチテナントの使用例、VMなどに適しています。App Direct 向けですが、メモリ モードも改善されます。「ワーストケース」の低下をターゲットにします。
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4.1(2) 以降 |
無効、レシピ 1、レシピ 2、レシピ 3、モード 0、モード 1、モード 2
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| CR FastGo設定 |
CR FastGo Config は、FastGO が無効になっている場合の DDRT 非一時書き込み帯域幅を改善します。FastGO を有効にすると、アンコアへの NT 書き込みのフローが高速になります。FastGO を無効にすると、CPU アンコアの NT 書き込みキューが減少し、DCPMM で連続して改善され、帯域幅が向上します。 |
4.1(2) 以降 |
自動、オプション 1 ～ 5、最適化を有効にする、最適化を無効にする
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| [DCPMM ファームウェアのダウングレード（DCPMM Firmware Downgrade）] | DCPMM ファームウェアのダウングレードを構成するには
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4.0（1）以降 |
無効、有効
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| メモリのリフレッシュレート |
内部メモリ用のリフレッシュ間隔レートを構成するには
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4.0（1）以降 |
自動、 1x 更新、2x 更新、3x、4x
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| eADRサポート |
拡張非同期 DRAM リフレッシュ (eADR) により、データを含む CPU キャッシュ ラインが適切なタイミング、必要な順序でフラッシュされます。電源障害から保護されたドメインにも含まれます。
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4.2(1) 以降 |
無効、有効、自動
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| メモリ帯域幅ブースト |
メモリ帯域幅を増やすことができます。
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4.2(1) 以降 |
無効、有効
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| メモリサイズの制限(GB) |
部分的なメモリのミラー モードの容量を、合計メモリ容量の 50% に制限します。メモリサイズは、0 GB ~ 65535 GB の範囲で 1 GB ずつ増加します。
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4.0(2) 以降 |
0：65535（ステップ サイズが 1） |
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| メモリのサーマル スロットリング モード |
メモリの温度が制限内にあることを保証する保護メカニズムを提供します。温度が最大閾値を超えると、メモリ アクセス レートが低下し、ベースボード管理コントローラ（BMC）がファンの回転数を調整してメモリを冷却し、過熱による DIMM の損傷を防ぎます
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4.0（1）以降 |
PECI を使用した CLTT、無効
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| NUMA最適化 |
BIOS で NUMA をサポートするかどうか設定します。
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4.0（1）以降 |
有効、無効
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| NVMパフォーマンス設定 |
NVM パフォーマンス設定により、DDR チャネル上の DDR と DDRT トランザクション間の効率的なメジャー モード調停が可能になり、チャネル BW と DRAM の遅延が最適化されます。 |
4.0(2) 以降 |
BW 最適化、レイテンシー最適化、バランシング プロファイル
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| オペレーションモード |
このオプションを使用すると、操作モードを構成できます。 |
4.2(1) 以降 |
テスト専用、テストと修復 |
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| パニックと高水準点 |
メモリ コントローラの遅延リフレッシュ機能を制御します。
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4.2(1) 以降 |
高、低
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| 部分的なキャッシュ行の節約 |
パーシャル キャッシュ ライン スペアリング (PCLS) は、メモリ コントローラーのエラー防止メカニズムです。PCLS は、メモリ アクセス中に置換できるように、ビットの欠陥のあるニブルの場所を、対応するデータ コンテンツとともにスペア ディレクトリに静的にエンコードします。
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4.2(1) 以降 |
無効、有効
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| メモリパーシャルミラーモード |
メモリ パーシャル ミラー モードを使用すると、GB 単位またはメモリ容量の割合によって部分的にミラーリングすることができます。ここで選択したオプションに応じて、使用可能なフィールドで、部分的なミラーの割合または部分的なミラー容量を GB 単位で定義できます。メモリ容量の最大 50% を部分的にミラーリングできます。
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4.1(1) 以降 |
無効、パーセンテージ、GB 単位の値
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| パーシャルミラー率 |
使用可能なメモリの総量を、合計メモリの割合として制限します。これは、0.000.01 %から 50.00 % まで、0.01 % 単位で増加させられます。
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4.1(1) 以降 |
0.00：50.00（0.01 のステップ サイズ） |
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| [パーシャル ミラー n GB 単位のサイズ（Partial Mirror n Size in GB）]。n の範囲は 1 ～ 4 です。 |
パーシャル ミラー n のメモリの量を GB 単位で制限します。これは、0 GB ~ 65535 GB の範囲で 1 GB ずつ増加します。
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4.1(1) 以降 |
0：65535（ステップ サイズが 1） |
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| PCIe RASサポート | PCIe RAS ポートが有効か、無効かどうか。
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4.0（1）以降 |
無効、有効
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ランタイム ポスト パッケージ修復 |
OS ランタイム中に修正されたメモリ エラーのソフト ポスト パッケージ修復を有効にします。
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4.3(4b) 以降 |
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| メモリRAS設定 |
サーバに対するメモリの RAS（信頼性、可用性、有用性）の設定方法です。 |
4.0（1）以降 |
最大パフォーマンス、ミラーリング、ロックステップ、ミラー モード 1LM、パーシャル ミラー モード 1LM、スペアリング、ADDDC スペアリング
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| PPRタイプの選択 |
Post Package Repair (PPR) は、スペア セルに置き換えて、障害のあるメモリ セルを修復する機能を提供します。
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4.1(1) 以降 |
無効、ハード PPR
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| 2LMのSnoopyモード |
すべての DRAM アクセスでディレクトリを維持しながら、DCPMM アクセスのスヌーピング モードを有効にします。スヌープは、ソケット間のキャッシュの一貫性を維持します。ディレクトリは、リモート ノード情報をローカル（メモリ内）に保持することでスヌープを削減します。ディレクトリのルックアップと更新により、メモリ トラフィックが追加されます。 ディレクトリは、DRAM には適していますが、DCPMM には必ずしも適していません。非 NUMA ワークロードの場合、この機能を有効にすると、DCPMM に対するディレクトリの更新が排除されるため、DDRT の帯域幅が制限されたワークロードに役立ちます。ディレクトリは、ファー メモリ アクセスに対して無効になっており、代わりにリモート ソケットをスヌーピングして所有権を確認します。ディレクトリは DRAM (メモリの近く) にのみ使用されます。 |
4.0（1）以降 |
無効、有効
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| ADのSnoopyモード |
すべての DRAM アクセスでディレクトリを維持しながら、DCPMM アクセスのスヌーピング モードを有効にします。スヌープは、ソケット間のキャッシュの一貫性を維持します。ディレクトリは、リモート ノード情報をローカル（メモリ内）に保持することでスヌープを削減します。ディレクトリのルックアップと更新により、メモリ トラフィックが追加されます。 ディレクトリは、DRAM には適していますが、DCPMM には必ずしも適していません。非 NUMA ワークロードの場合、この機能を有効にすると、DCPMM に対するディレクトリの更新が排除されるため、DDRT の帯域幅が制限されたワークロードに役立ちます。ディレクトリは AD へのアクセスに対して無効になり、代わりにリモート ソケットをスヌーピングして所有権を確認します。ディレクトリは DRAM アクセスにのみ使用されます。 |
4.0（1）以降 |
無効、有効
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| UMA |
名前が示すように、UMA ベースのクラスタリングは、プロセッサが Uniform Memory Access（UMA）ノードとして構成されている場合、つまり SNC が無効になっている場合に推奨されるクラスタリング モードです。
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4.2(1) 以降 |
無効：All-2All、Hemisphere-2-clusters、Quadrant-4-clusters
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| 揮発性メモリモード |
メモリ モードの構成を許可します。
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4.0(2) 以降 |
1LM、2LM
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エラー チェック スクラブ |
メモリ デバイスでメモリのチェック、修正、およびエラーのカウントを実行できるようにします。
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4.0(2) 以降 |
無効、 結果収集ありで有効、結果収集なしで有効 |
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[ランク マージン ツール（Rank Margin Tool）] |
メモリ マージン テストが自動化され、ランク レベルで DDR マージンを特定するために使用されます。
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4.0(2) 以降 |
有効、無効 |
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[アダプティブ リフレッシュ管理レベル（Adaptive Refresh Management Level）] |
更新管理（RFM）が必要な場合は、適応型更新管理（ARFM）レベルを選択します。
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4.0(2) 以降 |
デフォルト、レベル A、レベル B、レベル C | ||||||||
| Memory Mapped IO above 4GB |
64 ビット PCI デバイスの 4 GB 以上のアドレス空間に対するメモリ マップド I/O を有効または無効にします。レガシーなオプション ROM は 4 GB を超えるアドレスにアクセスできません。PCI デバイスが 64 ビット対応でも、レガシーなオプション ROM を使用する場合は、この設定をイネーブルにしても正しく機能しない場合があります。
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4.0（1）以降 |
無効、有効
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| [VGA の優先順位（VGA Priority）] |
システムに複数の VGA デバイスがある場合、VGA グラフィックス デバイスの優先順位を設定できるようにします。
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4.0(2) 以降 |
オフボード、オンボード、オンボード VGA が無効
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| 最適化された電力モード |
プロセッサの使用率に基づいて、プロセッサの速度と電力使用量を自動的に変更し、ワットごとのパフォーマンスを向上させます。中程度の使用率で最も効果的です。
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4.3(2) 以降 |
無効、有効
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| C1自動降格 |
有効にすると、CPU は非コア自動降格情報に基づいて C1 状態に自動的に降格します。
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4.0(2) 以降 |
無効、有効、自動
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||||||||
| C1自動降格解除 |
プロセッサが C1 降格状態から自動的に解除できるようにするかどうかを選択します。
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4.0(2) 以降 |
無効、有効、自動
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||||||||
|
強力なCPUパフォーマンス |
サーバー設定を自動的に調整することにより、CPU パフォーマンスを向上させます。
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4.0(2) 以降 |
無効、自動
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| LLCデッドライン |
CPU の非包括的キャッシュ スキームでは、中間レベル キャッシュ（MLC）から削除された内容が最終レベル キャッシュ（LLC）に書き込まれます。行を MLC から削除する際、コアはそれらにデッドとしてフラグを立てることがあります（再度読み取られる可能性が小さい場合）。LLC には、デッド ラインを削除し、LLC に書き込まないオプションがあります。
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4.0(2) 以降 |
無効、有効、自動
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| UPIリンク有効化 |
プロセッサが必要とする数のウルトラ パス インターコネクト（UPI）リンクを有効にします。
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4.0(2) 以降 |
自動、1、2、3 |
||||||||
| UPI電源管理 |
UPI 電力管理は、サーバーの電力を節約するために使用できます。
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4.0(2) 以降 |
無効、有効
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| XPTリモートプリフェッチ |
この機能は、LLC 要求を複製し、最近の LLC 履歴に基づいてリモート マシンの適切なメモリ コントローラに送信して、待ち時間を減らします。
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4.0(2) 以降 |
無効、有効
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||||||||
|
遅延の最適化モード |
省電力やその他の最適化よりも、低レイテンシと安定したパフォーマンスを優先する BIOS 設定のセット。
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4.3 (6a) |
無効、有効
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|
[QPI リンクの周波数選択（QPI Link Frequency Select）] |
Intel QuickPath Interconnect（QPI）のリンク周波数で、MT/s（毎秒 100 万転送）単位で選択します。 |
4.0(4) 以降 |
自動、9.6 GT/s、10.4 GT/s、11.2GT/s、12.8GT/s、14.4GT/s、16.0GT/s、20.0GT/s、16.0GT/s、20.0GT/s、24.0GT/s、自動、リンク設定ごとに使用
|
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| [レガシー USB のサポート（Legacy USB Support）] |
システムでレガシー USB デバイスをサポートするかどうか設定します。
|
4.2(1) 以降 |
自動、有効、無効 |
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| [USB ポート フロント（USB Port Front）] |
フロント パネルの USB デバイスを有効または無効にします。
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4.2(1) 以降 |
有効、無効 |
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| [USB ポート内部（USB Port Internal）] |
内部 USB デバイスを有効または無効にします。
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4.2(1) 以降 |
有効、無効 |
||||||||
| [USB ポート KVM（USB Port KVM）] |
USB ポート KVM デバイスを有効または無効にします。
|
4.2(1) 以降 |
有効、無効 |
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| [USB ポート リア（USB Port Rear）] |
USB ポート 背面デバイスを有効または無効にします。
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4.2(1) 以降 |
有効、無効 |
||||||||
| USBポート: M.2ストレージ（USB Port:M.2 Storage） |
SD カード ドライブを有効または無効にします。
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4.2(1) 以降 |
有効、無効 |
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| PRMRRサイズ |
プロセッサ予約済みメモリ範囲レジスタ（PRMRR）は、システム DRAM の保護領域のサイズです。 |
4.3(2) 以降 |
無効な構成、1G、2G、4G、8G、16G、32G、64G、128G、256G、512G、128M、自動、256M、512M
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||||||||
| [隣接キャッシュ行のプリフェッチ（Adjacent Cache Line Prefetcher）] |
プロセッサで必要な行のみを取得するのではなく、偶数または奇数のペアのキャッシュ行を取得するかどうか設定します。 |
4.0(2) 以降 |
無効、有効
|
||||||||
| [自律コア C 状態（Autonomous Core C state）] |
HALT 命令を MWAIT 命令に変換する CPU 自律 C-state を有効にします。 |
4.0(2) 以降 |
無効、有効 |
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| [ブート パフォーマンス モード（Boot Performance Mode）] |
オペレーティング システムのハンドオフ前に設定される BIOS パフォーマンス状態を選択できます。 |
4.0(2) 以降 |
最大パフォーマンス、最大効率、Intel NM に設定されました
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DFX OSB |
Opportunistic Snoop Broadcast（OSB）機能を制御します。OSB は、負荷の軽いリングまたは Intel UPI リンク状態でスヌープをブロードキャストするために CHA によって使用されます。これは、ディレクトリ ルックアップによる遅延を減らすために使用されます。 |
4.3(4a) 以降 |
自動、無効、有効 |
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| [プロセッサ CMCI（Processor CMCI）] |
CPU が corrected machine check events で割り込みをトリガーできるようにします。corrected machine check interrupt（CMCI）により、従来のポーリング タイマーよりも反応速度を向上できます。 |
4.0(2) 以降 |
無効、有効 |
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| 設定可能なTDPレベル |
Thermal Design Power（TDP）のカスタマイズされた値を設定できます。 |
4.0(2) 以降 |
通常、レベル 1、レベル 2 |
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| Core Multi Processing |
パッケージ内の CPU ごとの論理プロセッサ コアの状態を設定します。値として [すべて（All）] を選択すると、Intel ハイパースレッディング テクノロジーも有効になります。 |
4.0(2) 以降 |
すべて、1～86
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| [エネルギー パフォーマンス（Energy Performance）] |
システム パフォーマンスまたはエネルギー効率がこのサーバで重要かどうかを決定できるようにします。 |
4.0(2) 以降 |
パフォーマンス、バランスのとれたパフォーマンス、バランスのとれた電力、電力 |
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| [CPU パフォーマンス プロファイル（CPU Performance）] |
サーバー設定を自動的に調整することによる CPU パフォーマンス。 |
4.0(2) 以降 |
無効、有効 |
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| [エネルギー効率ターボ（Energy Efficient Turbo）] |
エネルギー効率の高いターボが有効になっている場合、CPU の最適なターボ周波数は、CPU 使用率に基づいてダイナミックになります。パワー/パフォーマンスのバイアス設定も、エネルギー効率の高いターボに影響します。 |
4.0(2) 以降 |
無効、有効 |
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| [拡張 Intel Speedstep テクノロジー（Enhanced Intel Speedstep\（R\) Technology）] |
プロセッサで拡張版 Intel SpeedStep テクノロジーを使用するかどうか設定します。このテクノロジーでは、プロセッサの電圧やコア周波数をシステムが動的に調整できます。このテクノロジーにより、平均電力消費量と平均熱発生量が減少する可能性があります。 |
4.0(2) 以降 |
無効、有効 |
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| プロセッサEPPの有効化 |
システム パフォーマンスまたはエネルギー効率がこのサーバで重要かどうかを決定できるようにします。 |
4.0(2) 以降 |
無効、有効 |
||||||||
| プロセッサ EPP プロファイル |
システム パフォーマンスまたはエネルギー効率がこのサーバで重要かどうかを決定できるようにします。 |
4.0(2) 以降 |
パフォーマンス、バランスのとれたパフォーマンス、バランスのとれた電力、電力 |
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| Execute Disable Bit |
サーバーのメモリ領域を分類し、アプリケーション コードを実行可能な場所を指定します。この分類の結果、悪意のあるワームがバッファにコードを挿入しようとした場合、プロセッサでコードの実行を無効化します。この設定は、損害、ワームの増殖、および特定クラスの悪意のあるバッファ オーバーフロー攻撃を防止するのに役立ちます。 |
4.0(2) 以降 |
無効、有効 |
||||||||
|
IOAT 構成 |
IOAT（Intel® I/O Acceleration Technology）アクセラレータで CPM（コンテンツ処理モジュール）を有効または無効にします。 |
4.3(3c) 以降 |
無効、有効 |
||||||||
| [ローカル X2 Apic（Local X2 Apic）] |
Advanced Processor Interrupt コントローラ （APIC）アーキテクチャのタイプを設定できます。 |
4.0(2) 以降 |
無効、有効 |
||||||||
| [ハードウェア プリフェッチ（Hardware Prefetcher）] |
プロセッサで、Intel ハードウェア プリフェッチャが必要に応じてデータおよび命令ストリームをメモリから取得し、統合 2 次キャッシュに入れることを許可するかどうか設定します。 |
4.0(2) 以降 |
無効、有効 |
||||||||
| [CPU ハードウェア パワー管理（CPU Hardware Power Management）] |
プロセッサの Hardware Power Management（HWPM）を有効にします。 |
4.0(2) 以降 |
無効化、HWPM ネイティブ モード、HWPM OOB モード、レガシーのないネイティブ モード |
||||||||
| [IMC インターリーブ（IMC Interleaving）] |
この BIOS オプションは、Integrated Memory Controller（IMC）間のインターリーブを制御します。 |
4.0(2) 以降 |
自動、1 方向インターリーブ、2 方向インターリーブ |
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| Intel Dynamic Speed Select |
Intel ダイナミック速度選択モードでは、ユーザーは自動モードで異なる速度とコアを使用して CPU を動作させることができます。 |
4.0(2) 以降 |
無効、有効 |
||||||||
| [インテル ハイパースレッディング テクノロジー（Intel HyperThreading Tech）] |
プロセッサでインテル ハイパースレッディング テクノロジーを使用するかどうか設定します。このテクノロジーでは、マルチスレッド ソフトウェア アプリケーションのスレッドを各プロセッサ内で並列に実行できます。 |
4.0(2) 以降 |
無効、有効 |
||||||||
| [インテル ターボ ブースト テクノロジー（Intel Turbo Boost Tech）] |
プロセッサでインテル ターボ ブースト テクノロジーを使用するかどうか設定します。このテクノロジーでは、仕様よりも低い電力、温度、または電圧でプロセッサが動作していると、自動的にそのプロセッサの周波数が上がります。 |
4.0(2) 以降 |
無効、有効 |
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| Intel(R) VT |
Intel Virtualization Technology for Directed I/O（VT-R）をプロセッサで使用するかどうか設定します。 |
4.0(2) 以降 |
無効、有効 |
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| [DCU IP プリフェッチ（DCU IP Prefetcher）] |
プロセッサで DCU IP プリフェッチ メカニズムを使用して履歴キャッシュ アクセス パターンを分析し、L1 キャッシュ内で最も関連性の高い行をプリロードします。 |
4.0(2) 以降 |
無効、有効 |
||||||||
| [KTI プリフェッチ（XPT Prefetch）] |
KTI プリフェッチは、DDR バス上でメモリ読み込みが早期に開始されるようにするメカニズムです。 |
4.0(2) 以降 |
無効、有効、自動
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||||||||
| LLC プリフェッチ（LLC Prefetch） |
プロセッサが LLC プリフェッチ メカニズムを使用してデータを LLC にフェッチするかどうか設定します。 |
4.0(2) 以降 |
無効、有効 |
||||||||
| [パッケージ C State リミット（Package C State Limit）] |
アイドル時にサーバ コンポーネントが使用できる電力量を設定します。 |
4.0(2) 以降 |
制限なし、自動、C0 C1 状態、C2、C6 非保持、C6 保持
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||||||||
| [パトロール スクラブ（Patrol Scrub）] |
フル メモリ スキャンの間隔を設定します。 |
4.0(2) 以降 |
無効、有効
|
||||||||
| パトロール スクラブの構成 |
フル メモリ スキャンの間隔を設定します。 |
4.0(2) 以降 |
有効、無効、POST 終了時に有効化
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||||||||
| [プロセッサ C1E（Processor C1E）] |
C1 に入ってプロセッサが最低周波数に遷移できるようにします。この設定は、サーバをリブートするまで有効になりません。 |
4.0(2) 以降 |
無効、有効 |
||||||||
| [プロセッサ C6 レポート（Processor C3 Report）] |
プロセッサからオペレーティング システムに C6 レポートを送信するかどうか。 |
4.0(2) 以降 |
無効、有効 |
||||||||
P STATE Coordination
|
BIOS がオペレーティング システムに P-state サポート モデルを伝達する方法を定義できます。Advanced Configuration and Power Interface（ACPI）仕様では、次の 3 つのモデルが定義されています。 |
4.0(2) 以降 |
SW All、HW All、SW Any
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||||||||
| [電力パフォーマンス調整（Power Performance Tuning）] |
BIOS または OS によってエネルギー パフォーマンスのバイアス調整をオンにできるかどうかを指定します。オプションは、BIOS とオペレーティング システムです。 |
4.0(2) 以降 |
BIOS、OS、PECI
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| UPI Link Frequency Select |
実行中の異なる UPI リンク周波数を選択できます。 |
4.0(2) 以降 |
自動、9.6GT/S、10.4GT/S、11.2GT/S、12.8GT/s、14.4GT/s、16.0GT/s、20.0GT/s、24.0GT/s、リンク設定ごとに使用
|
||||||||
| [サブ NUMA クラスタリング（Sub Numa Clustering）] |
CPU がサブ NUMA クラスタリングをサポートするかどうか設定します。そのクラスタリングでは、タグ ディレクトリとメモリ チャネルは常に同じ領域になります。 |
4.0(2) 以降 |
無効化された、有効化された、自動、SNC2、SNC4
|
||||||||
| [DCU ストリーマ プリフェッチ（DCU Streamer Prefetch）] |
プロセッサで DCU IP プリフェッチ メカニズムを使用して履歴キャッシュ アクセス パターンを分析し、L1 キャッシュ内で最も関連性の高い行をプリロードします。 |
4.0(2) 以降 |
無効、有効、自動
|
||||||||
| 非コア周波数スケーリング |
プロセッサの非コア部分の周波数のスケーリングを構成できます。 |
4.0(2) 以降 |
無効、有効、モード 0、およびモード 1
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||||||||
|
非コア周波数スケーリング IO |
I/O 操作を担当するプロセッサのコア解除コンポーネントの周波数を調整して、電力とパフォーマンスを最適化します。 |
6.0（1a）以降 |
モード 1、モード 0 |
||||||||
| [ワークロード設定（Workload Configuration）] |
この機能を使用すると、ワークロードを最適化できます。 |
4.0(2) 以降 |
平衡化、I/O 重視 |
||||||||
| [XPT プリフェッチ（XPT Prefetch）] |
XPT プリフェッチを使用して、最後のレベルのキャッシュに読み取り要求を送信できるようにして、その要求のコピーをメモリ コントローラのプリフェッチャに発行するかどうか設定します。 |
4.0(2) 以降 |
自動、無効、有効 |
||||||||
|
X2APICオプトアウト フラグ |
オペレーティング システムが x2APIC で動作していないときに、OS が拡張 xAPIC（x2APIC）モードを有効にしないようにします。 |
4.2(3) 以降 |
無効、有効 |
||||||||
|
[インテル Speed Select（Intel Speed Select）] |
異なる周波数で動作するように異なるコアを調整して、電力効率を向上させることができます。 値 Config 1 および Config 2 は、Cisco UCS M6 および M7 サーバではサポートされません。 Cisco UCS M6 および Cisco UCS M7 サーバの場合、Config 3 および Config 4（第 4 世代 Intel Xeon Scalable プロセッサおよび第 5 世代 Intel Xeon Scalable プロセッサ）の値は、 Config 1 および Config 2 の値 （第 3 世代 Intel Xeon スケーラブル プロセッサ）と同等です。 |
4.0(2) 以降 |
自動、ベース、構成 1、構成 2、構成 3、構成 4
|
||||||||
|
IIO eDPCサポート |
eDPC（Enhanced Downstream Port Containment）は、修正不可能なエラーが発生した後にダウンストリーム リンクを無効にすることで、制御された堅牢な方法で復旧を可能にします。次のいずれかになります。 |
4.3（6c）以降 |
無効、致命的なエラーで、致命的なエラーおよび致命的でないエラーで
|
||||||||
| [ボーレート（Baud Rate）] |
シリアル ポートの伝送速度として使用されるボー レート。[コンソール リダイレクション（Console Redirection）] を無効にした場合、このオプションを使用できません。 |
4.2(1) 以降 |
9.6k、19.2k、38.4k、57.6k、115.2k |
||||||||
| CDN Control |
一貫したデバイスの命名によって、一貫した方法でイーサネット インターフェイスに名前を付けることができます。これによりイーサネット インターフェイスの名前は、より統一され、識別しやすくなり、アダプタや他の設定に変更が加えられても永続的に保持されます。 |
4.2(1) 以降 |
有効、無効 |
||||||||
| [適応型メモリ トレーニング（Adaptive Memory Training）] |
このトークンが有効になっているときに、BIOS は CPU/メモリ設定情報と共にメモリ トレーニング結果(最適化されたタイミング/電圧値) を保存し、それらをその後のリブートに再使用して、ブート時間を短縮します。保存済みメモリのトレーニング結果は、最後の保存操作後の 24 時間以内に、リブートが発生した場合にのみ使用されます。 |
4.2(1) 以降 |
有効、無効 |
||||||||
| [BIOS Techlogレベル（BIOS Techlog Level）] |
このオプションは、 BIOS tech ログファイルのメッセージのタイプを示します。 |
4.2(1) 以降 |
最大、最大、標準
|
||||||||
| [オプション ROM 起動最適化（OptionROM Launch Optimization）] |
オプション ROM の起動は PCI スロット レベルで管理されます。デフォルトで有効になっています。多数のネットワーク コントローラおよびオプション ROM をもつストレージ HBA から成る設定では、すべてのオプション ROM は、PCI スロットのオプション ROM コントロールがすべてに対して有効になっている場合に起動できます。ただし、ブート プロセスでは、コントローラのサブセットのみを使用できます。このトークンが有効になっているときに、ブート ポリシーに存在するこれらのコントローラでのみ、オプション ROM が起動されます。 |
4.2(1) 以降 |
有効、無効 |
||||||||
| コンソール リダイレクション（Console Redirection） |
POST および BIOS のブート中に、シリアル ポートをコンソール リダイレクションで使用できるようにします。BIOS のブートが完了し、オペレーティング システムがサーバーを担当すると、コンソール リダイレクションの関連性はなくなり、無効になります。 |
4.2(1) 以降 |
無効、COM 0、COM 1
|
||||||||
| [フロー制御（Flow Control）] |
フロー制御にハンドシェイク プロトコルを使用するかどうかを設定します。送信要求/クリア ツー センド（RTS/CTS）を使用すると、隠れた端末の問題が原因で発生する可能性がある、フレーム コリジョンを減らすことができます。 |
4.2(1) 以降 |
なし、RTC-CTS |
||||||||
| [FRB 2 タイマー（FRB 2 Timer）] |
POST 中にシステムがハングアップした場合に、システムを回復するために FRB2 タイマーを使用するかどうかを指定します。 |
4.2(1) 以降 |
有効、無効 |
||||||||
| OS ウォッチドッグ タイマー |
BIOS が、定義済みのタイム アウト値を持つウォッチドッグ タイマーをプログラムするかどうか設定します。タイマーが切れる前にオペレーティング システムのブートが完了しないと、CIMC はシステムをリセットし、エラーがログに記録されます。 |
4.2(1) 以降 |
有効、無効 |
||||||||
| [OS Boot Watchdog Timer Policy |
ウォッチドッグ タイマーが切れた場合にシステムで実行されるアクション。 |
4.2(1) 以降 |
電源オフ、リセット |
||||||||
| OS Watchdog Timer Timeout |
BIOS でウォッチドッグ タイマーの設定に使用されるタイムアウト値。 |
4.2(1) 以降 |
5 分、10 分、15 分、20 分 |
||||||||
| [ターミナル タイプ（Terminal Type)] |
コンソール リダイレクションに使用される文字フォーマットのタイプ。 |
4.2(1) 以降 |
PC-ANSI、VT100、VT100-PLUS、VT-UTF8 |
||||||||
| Multikey Total Memory Encryption (MK-TME) |
MK-TME を使用すると、独自のキーを持つ 1 つの暗号化ドメインを複数持つことができます。異なるメモリ ページを異なるキーで暗号化できます。 |
4.2(1) 以降 |
有効、無効 |
||||||||
| [拡張ソフトウェア保護機能（SGX）（Software Guard Extensions (SGX)）] |
ソフトウェア ガード拡張（SGX）機能を有効にすることができます。 |
4.2(1) 以降 |
有効、無効 |
||||||||
| Total Memory Encryption(TME) |
システムの物理メモリ全体を暗号化する機能を提供します。 |
4.2(1) 以降 |
有効、無効 |
||||||||
| [所有者 EPOCH 入力タイプを選択（Select Owner EPOCH Input Type）] |
作成され、ロックされたメモリ領域に使用されるセキュリティ キーのシードを変更できます。 |
4.2(1) 以降 |
SGX 所有者 EPOCH が有効化されました、新しいランダム所有者 EPOCH への変更、手動によるユーザー定義所有者 EPOCH、SGX 所有者 EPOCH が無効化されました
|
||||||||
| SGX自動MP登録エージェント |
レジストレーション エージェント サービスがプラットフォーム キーを保存できるようにします。 |
4.2(1) 以降 |
有効、無効 |
||||||||
| [SGX Epoch 0] |
0 で指定された EPOCH 番号の SGX EPOCH 所有者値を定義できます。 |
4.2(1) 以降 |
ステップ サイズが 1 の 0 ～ fffffffffffffff |
||||||||
| [SGX Epoch 1] |
1 で指定された EPOCH 番号の SGX EPOCH 所有者値を定義できます。 |
4.2(1) 以降 |
ステップ サイズが 1 の 0 ～ fffffffffffffff |
||||||||
| SGX初期設定へのリセット |
その後の起動時にシステムが SGX の工場出荷時リセットを実行できるようにします。 |
4.2(1) 以降 |
有効、無効 |
||||||||
| n の範囲が 0 ～ 3 のSGX PubKey Hash n |
ソフトウェア ガード拡張（SGX）の値を設定できます。 |
4.2(1) 以降 |
SGX PUBKEY HASH0、SGX PUBKEY HASH1、SGX PUBKEY HASH2、SGX PUBKEY HASH3
|
||||||||
| SGX書き込みが有効 |
SGX 書き込み機能を有効にすることができます。 |
4.2(1) 以降 |
有効、無効 |
||||||||
| [SGX パッケージ情報インバンド アクセス（SGX Package Information In-Band Access）] |
SGX パッケージ情報インバンド アクセスを有効にすることができます。 |
4.2(1) 以降 |
有効、無効 |
||||||||
| SGX QoS |
SGX QoS を有効にすることができます。 |
4.2(1) 以降 |
有効、無効 |
||||||||
| SHA-1 PCRバンク |
プラットフォーム構成レジスタ（PCR）は、TPM 内のメモリ位置です。複数の PCR をまとめて PCR バンクと呼びます。セキュア ハッシュ アルゴリズム 1 または SHA-1 PCR バンクでは、TPM セキュリティを有効または無効にすることができます。 |
4.2(1) 以降 |
有効、無効
|
||||||||
| SHA256 PCRバンク |
プラットフォーム構成レジスタ（PCR）は、TPM 内のメモリ位置です。複数の PCR をまとめて PCR バンクと呼びます。セキュア ハッシュ アルゴリズム 256 ビットまたは SHA-256PCR バンクでは、TPM セキュリティを有効または無効にすることができます。 |
4.2(1) 以降 |
有効、無効 |
||||||||
|
SHA384 PCR バンク * |
プラットフォーム構成レジスタ（PCR）は、TPM 内のメモリ位置です。複数の PCR をまとめて PCR バンクと呼びます。セキュア ハッシュ アルゴリズム 384 ビットまたは SHA-384PCR バンクでは、TPM セキュリティを有効または無効にすることができます。 |
4.3(3a) 以降 |
有効、無効 |
||||||||
| [信頼されたプラットフォーム モジュールの状態（Trusted Platform Module State）] |
サーバーの認証に使用するアーティファクトを安全に保存するコンポーネントであるトラステッド プラットフォーム モジュール（TPM）の有効と無効を切り替えます。 |
4.2(1) 以降 |
有効、無効 |
||||||||
|
Trust Domain Extension |
機密データとアプリケーションを不正アクセスから保護する Trust Domain Extension（TDX）を有効にするか無効にするか。 |
4.3(3a) 以降 |
有効、無効 |
||||||||
|
TDX Secure Arbitration Mode（SEAM）ローダ |
Intel TDX モジュールのデジタル署名を検証し、SEAM メモリ範囲にロードするのに役立つ TDX セキュア アービトレーション モード（SEAM）ローダーを有効にするか無効にするか。 |
4.3(3a) 以降 |
TDX Secure Arbitration Mode（SEAM）ローダ |
||||||||
| TPM保留中の操作 |
トラステッド プラットフォーム モジュール（TPM）Pending Operation オプションを使用すると、保留中の操作のステータスを制御できます。 |
4.2(1) 以降 |
なし、TpmClear |
||||||||
| [TPM の最小限の物理的存在（TPM Minimal Physical Presence）] |
TPM の最小限の物理的存在を有効または無効にするかどうか。セキュリティを損なうことなく TPM を管理するために、OS と BIOS 間の通信を有効または無効にします。 |
4.2(1) 以降 |
有効、無効 |
||||||||
| [Intel Trusted Execution Technology のサポート（Intel Trusted Execution Technology Support）] |
ビジネス サーバー上で使用され、保管される情報の保護機能を強化する、Intel Trusted Execution Technology（TXT）の有効と無効を切り替えます。 |
4.2(1) 以降 |
有効、無効 |
||||||||
|
セキュリティデバイスのサポート |
TPM 機能全体を制御します。 |
4.2(3) 以降 |
有効、無効 |
||||||||
|
[DMA 制御オプトイン フラグ（DMA Control Opt-In Flag）] |
このトークンを有効にすると、Windows 2022 カーネル DMA 保護機能が有効になります。OS はこれを、悪意のあるデバイスからの DMA 攻撃を防ぐために IOMMU を有効にする必要があるというヒントとして扱います。 |
4.2(2) 以降 |
有効、無効 |
||||||||
|
[CPU PA を 46 ビットに制限（LIMIT CPU PA to 46 Bits）] |
古い Hyper-v CPU プラットフォームをサポートするために、CPU 物理アドレスを 46 ビットに制限します。 |
4.2(2) 以降 |
有効、無効 |
 （注） |
SHA384 PCR バンク BIOS トークンは、PID モデル UCS-TPM-002D および UCS-TPM-002D-D をサポートします。 |
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